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Detalles sobre las instrucciones SSE4 y su llegada este año

Mie Ene 31, 2007 12:02 am
   
Daily Tech nos comenta que Intel añadió mejoras en la ejecución de instrucciones SSE con los procesadores popularmente conocidos como Conroe. Con ellos se optimizó el rendimiento de las instrucciones SSE, SSE2 y SSE3 para que se ejecutaran este tipo de instrucciones de 128 bits en un solo ciclo de reloj.

Hasta la fecha, la arquitectura Core (No la Core 2) y Netburst requerían de dos ciclos de reloj para realizar este tipo de operaciones. Ahora se plantean nuevos cambios en un futuro no muy lejano: las SSE4

Tal y como hemos comentado estas SSE4 llegarán con los núcleos Penryn a finales de este mismo año. Son 50 nuevas instrucciones que incluyen mejoras para la compilación de vectores, mejoras en el procesado de texto, cadenas y contenidos multimedia y algunas otras mejoras: "optimize vector compiling, media, string and text processing and application targeted accelerators"

Nos parece entender que a pesar de la introducción de estas instrucciones con los Penryn no llegarán a la madurez hasta la nueva generación de procesadores de Intel, los Nehalem. También es lógico pensar que los programadores necesitarán tiempo para optimizar su software para estas nuevas instrucciones y por lo tanto cuanto antes estén disponibles ni que sea para poderlas probar para futuros desarrollos, mejor.

Abrahamx

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